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IGLOO2 FPGA Libero SoC项目

宣布时间:2019年04月30日 12:04    宣布者:ningxueqin
  应用FPGA阻拦设计就像玩积木玩具;您的想法主意主意是许多基本模块的荟萃,将它们组合起来将构建系统。第一个模块是相机控制接口(CCI),它控制系统控制单元的时序。此模块在185ms延迟后启动,以确保当FIFO为空而且UART准备好发送时热传感器完成同步。
  这两个条件是有用的,由于数据须要存储在SRAM中才干有足够的时间在发送到UART之前取得一个全帧。FIFO是一组FIFO控制器和SRAM。FIFO控制器从CCI传输一个字节到SRAM。SRAM积累了一个视频帧后,FIFO控制器将所有内容发送到UART,清空存储器。这些设计可以看作是一种灌水算法,与通讯系统设计中应用的一样。
  要推敲的此外一个方面是CCI和UART的速率。FLIR的Lepton数据手册中划定,CCI必须在2MHz至20MHz的规模内使命;而UART的使命频率须要确保分组不被笼罩而且在适当的时间启用CCI。是以,CCI频率设置成20MHz,UART频率为24MHz,波特率为460800波特。
  为了使同步治理更容易,CCI与热传感器通讯,并推行FLIR Lepton数据手册中指定的四个主要同步行动:
  撤消片选并停用SPI时钟至少5帧周期(&gt;185ms),以确保VoSPI接口将Lepton置于准确的状态,以培植或重新培植同步。
  设置片选并启用SPI时钟,使Lepton泉源发送第一个数据包。
  检查数据包的ID字段,识别扬弃的数据包。
  一连读取数据包。当新的帧可用时(在设置片选并读取第一个数据包以后的39ms内),将会发送第一个视频数据包。主机和从机现在曾经同步。
  CCI泉源与热模块通讯,吸收数据包并泉源处置赏罚赏罚。在其默许装备下,相机将发送164字节长的数据包,其中网罗4个公用于ID和CRC的字节和160个有用载荷字节,如图4所示。有用载荷体现80像素的温度值,接纳14位编码。数据包或行的每个像素都界说成2个字节。
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